Design Verification Architect

🕒 Julho 27

🏄 California – Remoto

🏄 California – Remote

💵 $150.000 - $300.000 / ano

⏰ Tempo Integral

🟠 Sênior

🔴 Especialista

🏛️ Arquiteto

👻 Score fantasma 32%

O que significa: quão provável esta vaga está aberta sem contratação ativa.Como ler: 60% ou mais significa que achamos que é uma vaga fantasma. Pontuações mais baixas preocupam menos.Como pontuamos: tempo em aberto, republicações, vagas abertas vs tamanho do time, rapidez para fechar vagas, e se o salário está divulgado.Observação: é uma estimativa de dados públicos, não um julgamento da empresa. Vagas reais podem ter pontuação alta, então use como uma dica, não como um fato.

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TYLsemi

SiteLinkedInTodas as Vagas

11 - 50 funcionários

Fundada em 2026

🔧 Hardware

🤖 Inteligência Artificial

🤝 B2B

Hardware • Artificial Intelligence • B2B

A TYLsemi é uma empresa de silício focada em chiplets para soluções de infraestrutura de IA. A empresa oferece chiplets validados e prontos para produção, além de uma plataforma unificada que leva os projetos da arquitetura ao silício implantado, possibilitando um desenvolvimento mais rápido e com menos riscos de sistemas de IA. As ofertas da TYLsemi (sob as marcas TYL. IO, TYL. Power, TYL. Forge) são direcionadas a funções críticas de infraestrutura de IA—XPUs, switches, conectividade, energia e escalabilidade de sistemas—e a empresa também oferece silício customizado com chiplets, integração de embalagem e fabricação. A empresa promove um desenvolvimento até 50% mais rápido e custos reduzidos, e recentemente arrecadou US$ 43 milhões em uma rodada de financiamento inicial superada.

Descrição

• Define and drive the overall verification architecture for large-scale SoCs, ensuring scalability from IP → subsystem → full SoC level • Architect and develop reusable, modular, and portable verification platforms that can be leveraged across multiple chip programs • Establish methodologies for seamless reuse and portability, including Portable Stimulus (PSS)-based verification flows • Lead the development of high-performance, coverage-driven testbenches using industry-standard methodologies (e.g., UVM) • Drive multi-level verification strategies, enabling efficient scaling across: Block-level, Multi-block/subsystem level, Full-chip SoC level • Define and enforce verification quality metrics, coverage closure strategies, and sign-off criteria • Champion a “fail-fast” philosophy to detect issues early and improve overall design quality • Drive initiatives toward first-pass silicon success, minimizing escapes and post-silicon debug effort • Leverage AI/ML techniques and AI agents to: Automate testbench generation, Improve stimulus generation and coverage closure, Enhance regression efficiency and debug productivity, Enable intelligent verification QA and anomaly detection • Collaborate closely with design, architecture, physical design, and software teams to ensure alignment and early issue detection • Mentor and guide DV teams on best practices, methodology adoption, and architectural decisions.

🎯 Requisitos

• Bachelor’s/Master’s degree in Electrical Engineering, Computer Engineering, or related field • 12+ years of experience in Design Verification, with significant exposure to large SoC verification • Proven experience in defining and deploying verification architectures for complex chips • Strong expertise in: SystemVerilog and UVM • Coverage-driven verification (functional + code coverage) • Assertion-based verification (SVA) • Hands-on experience with Portable Stimulus (PSS) and cross-level stimulus reuse • Deep understanding of SoC architectures in AI, HPC, or Networking domains • Experience with multi-IP integration challenges, coherency, high-speed interfaces, and large-scale data movement • Strong debugging skills and ability to handle complex system-level issues.

🏖️ Benefícios

• No Politics, No Bureaucracy • Remote-Friendly, Global Team • Move Fast, Ship Real Products • Ownership mindset. • Bias for action. • Deep technical expertise. • Low ego, high standards.