FPGA Developer, Digital Signal Processing

Vaga não está no LinkedIn

🕒 Julho 28

🇺🇸 Estados Unidos – Remoto (EUA)

⏰ Tempo Integral

🟡 Pleno

🟠 Sênior

🖥 Engenheiro de Software

👻 Score fantasma 22%

O que significa: quão provável esta vaga está aberta sem contratação ativa.Como ler: 60% ou mais significa que achamos que é uma vaga fantasma. Pontuações mais baixas preocupam menos.Como pontuamos: tempo em aberto, republicações, vagas abertas vs tamanho do time, rapidez para fechar vagas, e se o salário está divulgado.Observação: é uma estimativa de dados públicos, não um julgamento da empresa. Vagas reais podem ter pontuação alta, então use como uma dica, não como um fato.

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HR Buddys

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11 - 50 funcionários

Fundada em 2022

💼 Consultoria

🎯 Recrutamento

🤝 B2B

Consulting • Recruitment • B2B

A HR Buddys é uma empresa alemã de serviços e consultoria em RH, focada em auxiliar startups e empresas em estágio inicial a estabelecer processos de RH profissionais desde o primeiro dia. Eles oferecem terceirização de RH, recrutamento e gerenciamento de talentos, branding empregador, administração de folha de pagamento e pessoal, contratos, integração/desligamento, diversidade e inclusão, planejamento organizacional e de pessoal, além de um centro de ajuda que pode contar com especialistas parceiros. A HR Buddys busca posicionar startups como empregadores profissionais, gerenciar recrutamento e experiência de candidatos, apoiar necessidades de Employer of Record e, por fim, construir e transferir uma função de RH interna.

Descrição

• HDL design and implementation • Implementation of HDL designs in VHDL. • Design and implementation of well-structured, reusable, and well-documented RTL modules for the measurement signal chain. • Timing analysis and design optimization up to timing closure. • Design and implementation of digital signal processing algorithms, in particular: IIR/FIR filters, decimation and resampling, frequency-domain analysis (FFT). • Implementation of the DSP chain with a focus on accuracy, numerical stability, and resource efficiency on the FPGA. • Design and implementation of high-speed I/O interfaces to ADCs, processor systems, real-time fieldbuses and other devices. • Contribution to the design of I/O and SoC integration for the first development phase, together with the Chief Architect. • Design and implementation of testbenches for simulation, testing and verification. • Documentation of designs and verification results to ensure reliable interfaces and compliance with specifications.

🎯 Requisitos

• Bachelor’s degree or equivalent qualification in a STEM field. • At least 5 years of professional experience in FPGA design. • Demonstrable expertise in digital signal processing (IIR/FIR filters, FFT, resampling algorithms). • Confident handling of HDL design in VHDL. • Solid understanding of timing constraints and optimization techniques for timing closure. • Experience with simulation tools such as ModelSim and with established verification techniques. • Proficient with AMD Vivado. • Business-fluent English (C1+) OR business-fluent German (C1+) with English at B2 level. • Nice to have: Experience with real-time fieldbuses (EtherCAT, PROFINET). • Experience with integrated SoCs (AXI/Avalon, EMIO, etc.). • Experience with soft processors (MicroBlaze, Nios, Embedded C). • Knowledge of control engineering. • Experience with high-speed techniques for serial and parallel I/O.

🏖️ Benefícios

• Freedom to shape the role from day one: You will build the FPGA development function within the company and shape the design culture. • Direct access to the Chief Architect and founding team. • Short communication lines, clear decision-making, no organizational politics. • Technically demanding work: Class-A power-quality measurement technology at the limits of what is technically feasible. • Market tailwinds: Data centers, the energy transition and EU regulation provide significant momentum in the power-quality segment. • Attractive compensation package with a fixed salary and variable components. • Growth perspective: As the function expands, development into an FPGA/DSP team is explicitly planned, including I/O and fieldbus development.