Principal ASIC Design Verification Engineer

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K2 Space Corporation

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11 - 50 Mitarbeiter

Gegründet 2022

🎖️ Verteidigung

📦 Logistik

🏭 Fertigung

Defense • Logistics • Manufacturing

Die K2 Space Corporation ist ein in Kalifornien ansässiger Hersteller in der Raumfahrtindustrie, der große, leistungsstarke Satellitenbusse entwirft und produziert. Diese sollen deutlich mehr Leistung, Masse und Nutzlastvolumen zu geringeren Kosten als herkömmliche große Satelliten bieten. Das Unternehmen legt Wert auf Produktionslinienfertigung und kommerzielle Lieferketten, um Durchlaufzeiten zu verkürzen und die Kosten pro Einheit zu senken. Dies ermöglicht Multi-Manifest-Starts und Multi-Orbit-Missionen in LEO (Low Earth Orbit), MEO (Medium Earth Orbit), GEO (Geostationary Earth Orbit) und im zislunaren Raum. K2 bedient kommerzielle, wissenschaftliche sowie Regierungs-/Verteidigungskunden und konzentriert sich auf Missionen, die hohe Datenübertragungskapazitäten und leistungsstarke Nutzlasten erfordern.

Beschreibung

• Verify the functionality, performance, and robustness of custom silicon designs. • Define verification approach and contribute to methodology. • Develop and execute verification plans for block-level, subsystem-level, and full-chip environments. • Build SystemVerilog/UVM test benches, including agents, monitors, scoreboards, checkers, and coverage models. • Write SystemVerilog Assertions (SVA) and integrate formal verification where appropriate. • Drive constrained-random and directed testing strategies to validate functionality, corner cases, and stress scenarios. • Run simulations, triage failures, drive root-cause analysis, and collaborate with RTL designers to resolve issues. • Implement and maintain functional coverage, code coverage, assertion coverage, and ensure coverage closure for sign-off. • Manage regression testing, simulation farms, and CI pipelines to ensure high test throughput and fast debug iterations. • Participate in design reviews, microarchitecture discussions, and influence design-for-verification (DFV) best practices. • Work closely with architecture, RTL design, DFT, firmware, physical design, and silicon validation engineers to ensure end-to-end coverage and test. • Support silicon bring-up and post-silicon validation through test reuse, diagnostics, and debug analysis. • Participate in ASIC team interviews. • Drive advancement of DV methodologies and improvements. • Manage external IP providers and verification partners when needed. • Take lead on large and/or complex systems.

🎯 Anforderungen

• B.S. or M.S. in Electrical Engineering, Computer Engineering, or related field. • 10+ years of experience in ASIC/SoC verification. • Solid understanding of SystemVerilog, digital logic, RTL design, DFT, and hardware design and verification flows. • Proficiency with several simulation (VCS, Xcelium, Questa), waveform debug (Verdi, SimVision), coverage tools, and scripting languages (ex: Python, Perl, TCL). • Experience with test planning, UVM-based testbench development, constrained-random testing, functional coverage, and SystemVerilog assertions. • Experience with regression management, coverage analysis, revision control (ex: Git), CI/CD automation, and gate-level simulation. • Experience with developing and integrating reference models. • Experience with embedded processor-based designs and firmware/bare metal coding (ex: C, C++). • Understanding of many industry-standard interfaces (ex: APB/AHB/AXI). • Involvement in post-silicon validation planning and execution.

🏖️ Vorteile

• Comprehensive benefits package including paid time off • Medical/dental/vision coverage • Life insurance • Paid parental leave • Other perks