Senior Formal Verification Engineer – Vector Unit

🕒 vor 3 Monaten

🤠 Texas – Remote

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⏰ Vollzeit

🟠 Senior

👷🏻‍♀️ Ingenieur

👻 Geisterscore 42%

Was es bedeutet: wie wahrscheinlich diese Stelle offen bleibt, ohne dass aktiv eingestellt wird.So liest du es: 60 % oder höher heißt, wir halten das für einen Geisterjob. Niedrigere Werte sind weniger bedenklich.Wie wir werten: Dauer offen, Neuveröffentlichungen, offene Stellen vs Teamgröße, wie schnell Stellen geschlossen werden, und ob ein Gehalt angegeben ist.Hinweis: eine Schätzung aus öffentlichen Daten, kein Urteil über das Unternehmen. Echte Stellen können hoch punkten, nutze es also als Hinweis, nicht als Fakt.

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51 - 200 Mitarbeiter

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🎯 Rekrutierung

Marketing • Logistics • Recruitment

TechBiz Global ist ein führendes Unternehmen für Recruiting und Softwareentwicklung und darauf spezialisiert, Unternehmen in über 28 Ländern mit Top-Talenten zu vernetzen. Wir betreuen Kunden von Startups bis hin zu Großunternehmen und bringen Expertise in der Besetzung von Schlüsselrollen in Branchen wie FinTech ein. Neben Talent Acquisition bietet TechBiz Global umfassende Softwareentwicklungs-Services, um die Visionen der Kunden in die Realität umzusetzen und digitale Transformationen mit erfahrenen Expertenteams voranzutreiben. Das Unternehmen bietet zudem strategisches CTO-Consulting sowie flexible Outstaffing- und Outsourcing-Lösungen, die Unternehmen dabei unterstützen, Wachstum zu steuern und Technologieprozesse zu optimieren. Als anerkannte Top-Adresse für IT-Recruiting und Consulting ist TechBiz Global darauf ausgerichtet, maßgeschneiderte und innovative Lösungen zu liefern und sicherzustellen, dass Kunden über die notwendigen Werkzeuge für ihren Erfolg verfügen.

Beschreibung

• Design, deploy, and maintain robust formal verification environments for complex Vector Unit sub-blocks • Implement advanced word-level modeling, bit-blasting, and algebraic rewriting strategies • Independently diagnose and resolve proof-convergence failures, over-constraints, and state-space explosions • Develop formal environments to mathematically prove compliance with the RISC-V Vector Extension specification • Collaborate closely with simulation engineers to ensure maximum bug-hunting efficiency

🎯 Anforderungen

• B.S./M.S. in Computer Engineering, Electrical Engineering, or Computer Science; or a Ph.D. in formal methods or computer arithmetic • 5+ years of production-grade hardware verification experience (or Ph.D. + 1–3 years) • Strong specialization in arithmetic formal verification, algebraic rewriting, and word-level modeling • Good working knowledge of high-width execution pipelines, vector execution units, or floating-point/integer arithmetic hardware • Proficient command of commercial EDA formal tools (e.g., Cadence JasperGold/DPV, Synopsys VC Formal, Siemens OneSpin) • Native fluency in SystemVerilog and SVA; Scripting proficiency (Python, Tcl, or Bash)

🏖️ Vorteile

• Professional development opportunities • Flexible working arrangements