Lead DFT Engineer

🕒 Agosto 13

🌐 Canadá, Estados Unidos – Remoto

🇨🇦 Canadá – Remoto 🇺🇸 Estados Unidos – Remoto (EUA)

💵 $200.000 - $250.000 / ano

⏰ Tempo Integral

🟠 Sênior

👷🏻‍♀️ Engenheiro

👻 Score fantasma 2%

O que significa: quão provável esta vaga está aberta sem contratação ativa.Como ler: 60% ou mais significa que achamos que é uma vaga fantasma. Pontuações mais baixas preocupam menos.Como pontuamos: tempo em aberto, republicações, vagas abertas vs tamanho do time, rapidez para fechar vagas, e se o salário está divulgado.Observação: é uma estimativa de dados públicos, não um julgamento da empresa. Vagas reais podem ter pontuação alta, então use como uma dica, não como um fato.

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EnCharge AI

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11 - 50 funcionários

Fundada em 2022

🤖 Inteligência Artificial

🔧 Hardware

🤝 B2B

💰 $100.000.000 Series B - EnCharge AI em 2025-02

Artificial Intelligence • Hardware • B2B

A EnCharge AI é uma empresa que desenvolve hardware de computação analógica em memória e software complementar para acelerar cargas de trabalho de IA em dispositivos e da borda para a nuvem. Sua tecnologia inclui o acelerador analógico de IA EN100 e outras formas (chiplets, ASICs, placas PCIe) projetadas para fornecer muito maior eficiência energética, densidade computacional e menor custo total de propriedade para inferência em comparação com GPUs convencionais e aceleradores digitais. A EnCharge enfatiza a sustentabilidade, a privacidade de dados por meio do processamento local e a implantação para clientes empresariais e desenvolvedores que buscam computação de IA eficiente e escalável fora da infraestrutura tradicional de nuvem.

Descrição

• Define and implement the end-to-end DFT architecture for complex SoCs, including Hierarchical DFT, Scan compression, Boundary Scan and MBIST • Develop In-System Test (IST) and power-on self-test (POST) strategies for chip health in remote edge data centers • Oversee scan insertion, ATPG (Stuck-at, Transition, Path Delay), and Memory/Logic BIST • Collaborate with Design, Physical Design, and Yield teams to achieve high test coverage while minimizing area overhead and power impact, including timing analysis • Lead silicon bring-up and debug on ATE to root-cause silicon failures and optimize test time

🎯 Requisitos

• 12+ years of experience in DFT, including at least 2 years in a leadership or principal role • Bachelor’s degree in a related field • Mastery of Synopsys TestMAX, Siemens/Mentor Tessent, or Cadence Modus • Deep expertise in MBIST with repair capabilities, SCAN, IJTAG (IEEE 1687), and boundary scan (IEEE 1149.1/6) • Proven track record with FinFET nodes (7nm, 5nm, or below) • Experience managing DFT in multi-voltage/power-gated designs