Analogentwicklungsingenieur (m/w/d), Level 4

🔥 vor 54 Minuten

🇩🇪 Deutschland – Remote

⏰ Vollzeit

🟠 Senior

🔴 Experte

🧑‍💻 Full-Stack-Entwickler

👻 Geisterscore 10%

Was es bedeutet: wie wahrscheinlich diese Stelle offen bleibt, ohne dass aktiv eingestellt wird.So liest du es: 60 % oder höher heißt, wir halten das für einen Geisterjob. Niedrigere Werte sind weniger bedenklich.Wie wir werten: Dauer offen, Neuveröffentlichungen, offene Stellen vs Teamgröße, wie schnell Stellen geschlossen werden, und ob ein Gehalt angegeben ist.Hinweis: eine Schätzung aus öffentlichen Daten, kein Urteil über das Unternehmen. Echte Stellen können hoch punkten, nutze es also als Hinweis, nicht als Fakt.

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Ciena

WebsiteLinkedInAlle Stellen

5001 - 10000 Mitarbeiter

Gegründet 1985

📡 Telekommunikation

🔧 Hardware

💰 Series C im 1995-12

Telecommunications • Hardware • Networking

Ciena ist ein weltweit führender Anbieter von optischen und Routing-Systemen, Services und Automatisierungssoftware. Wir bauen die weltweit adaptivsten Netzwerke, um den stetig steigenden digitalen Anforderungen nach reichhaltigeren, stärker vernetzten Erlebnissen für alle Nutzer gerecht zu werden. Seit über drei Jahrzehnten verbinden wir unser ausgeprägtes Gespür für Menschlichkeit mit unserem unermüdlichen Streben nach Innovation.

Beschreibung

• Verantwortung für das Design auf Schaltplanebene und die Post-Layout-Verifikation von Hochgeschwindigkeits-Sender-Signalpfaden und linearen Signalverarbeitungsketten, einschließlich DAC-basierter Ausgangsstufen, High-Swing-/High-Speed-Treiberschnittstellen, ESD und Bumps • Zusammenarbeit mit dem Management, Systemdesignern und Laborvalidierungsteams zur Weiterentwicklung der Architektur sowie zur Erfüllung von Standard- und Produktanforderungen • Bewertung von Schaltungstopologien und Empfehlung geeigneter Implementierungen unter Berücksichtigung von Zielkonflikten zwischen Leistungsaufnahme, Fläche, Bandbreite und Technologie • Zusammenarbeit mit Layout- und Designingenieuren, um Designs bis zur vollständigen GDSII-Integration umzusetzen • Steuerung extraktionsbasierter Post-Layout-Simulationen und Validierung der Senderleistung über Prozess-, Spannungs- und Temperaturbedingungen hinweg • Durchführung von Ursachenanalysen bei Abweichungen zwischen Design- und Post-Layout-Leistung sowie Umsetzung korrigierender Designmaßnahmen • Überwachung der Leistung und Leistungsaufnahme auf Block- und Senderebene im Abgleich mit den vereinbarten Zielwerten • Überführung von Architektur- und Systemanforderungen in Senderimplementierungen sowie Rückführung von Design- und Silizium-Erkenntnissen in künftige Architekturen • Erstellung und Verwendung von Verhaltens- und Designmodellen, beispielsweise in MATLAB und Verilog-A • Zusammenarbeit mit Laborvalidierungsteams, um Siliziumergebnisse mit Simulationen abzugleichen und Testchip- sowie Produktinbetriebnahmen und Charakterisierungen zu unterstützen • Technische Anleitung und Mentoring für Junior-Design- und Layoutingenieure • Regelmäßige Berichterstattung zum Status und regelmäßiger Erfahrungsaustausch mit dem Team

🎯 Anforderungen

• Masterabschluss oder Promotion in Elektrotechnik, Computer Engineering oder einer vergleichbaren naturwissenschaftlich-technischen Fachrichtung • Mindestens 10 Jahre Berufserfahrung in der Entwicklung von Hochgeschwindigkeits-Analog-, Mixed-Signal- oder SerDes-Senderschaltungen in modernen CMOS-Technologien, einschließlich Schaltungsentwurf bis zur Post-Layout-Verifikation • Erfahrung mit Sender-Schaltungsblöcken, darunter DAC-basierte Ausgangsstufen, Serializer oder Multiplexer, Ausgangstreiber und Taktschaltungen • Erfahrung mit Post-Layout- und extraktionsbasierten Simulationen über verschiedene Prozess-, Spannungs- und Temperaturbedingungen hinweg • Erfahrung in der Umsetzung analoger Schaltungsdesigns bis zur Validierung im Silizium • Erfahrung im Umgang mit Tools von Cadence, Mentor oder Synopsys, einschließlich Virtuoso, Calibre, STAR-RC und MMSIM • Nachweislich ausgeprägte schriftliche und mündliche Kommunikationsfähigkeiten • Fähigkeit, selbstständig und im Team zu arbeiten • Erfahrung mit 224G- oder 448G-PAM4- bzw. PAM6-SerDes sowie den zugehörigen OIF-CEI- oder IEEE-Standards • Erfahrung in der Mitwirkung an Senderarchitekturen mit MATLAB, Verilog-A oder C++ • Erfahrung mit Methoden für Signal Integrity, Power Integrity, Channel- und Package-Co-Design, einschließlich EM-Tools wie HFSS oder EMX • Erfahrung im Mentoring von Ingenieuren in Teams für das Design analoger Makros • Erfahrung mit der Mixed-Signal-Validierung unter Einsatz von Hochgeschwindigkeits-Mess- und Tastkopfausrüstung

🏖️ Vorteile

• Flexibles Arbeitsumfeld • Mitarbeiterorientierte Unternehmenskultur mit Fokus auf persönlicher Entwicklung, Wohlbefinden und Zugehörigkeit • Ausdrückliches Engagement für Vielfalt, Gleichbehandlung und Inklusion • Angemessene Maßnahmen zur Arbeitsplatzanpassung für Bewerberinnen und Bewerber mit Behinderungen